国产成人精品第一区二区三区,亚洲一日韩欧美中文字幕不卡,午夜国产成人福利视频 360doc--雪山白鳳凰_的文章 http://shoufuban.net/rssperson/64556539.aspx 360doc (http://shoufuban.net) zh-cn 360doc--個人圖書館 基于AHB總線的master讀寫設(shè)計(Verilog) http://shoufuban.net/content/24/1106/18/64556539_1138661347.shtml 2024/11/6 18:16:52
assign htrans_o = (fsm_rd_addr || fsm_wr_addr) ?wire addr_add_en = (main_fsm_r == S1 || main_fsm_r == S2) && (fsm_rd_addr || fsm_rd_rd || fsm_wr_addr || fsm_wr_wd);else if(main_fsm_r == S1 &fsm_rd_busreq &hready_i) haddr_r <= rd_base_addr;else if(main_fsm_r == S1 &(fsm_rd_rd || fsm_rd_lrd) &hready_i) rd_data_r <= hrdata_i;assign hwdata_o = (main_fsm_r == S2 &(fsm_wr_wd || fsm_wr_lwd) &hready_i) ?
STM32定時器的使用(定時器中斷、PWM輸出和跳變捕獲、主從模式) http://shoufuban.net/content/24/0927/17/64556539_1135178521.shtml 2024/9/27 17:00:14
其中TIM6、TIM7是基本定時器,TIM2、TIM3、TIM4和TIM5是通用定時器,而TIM1和TIM8是高級定時器。#include "stm32f10x_gpio.h"#include "stm32f10x_rcc.h"#include "stm32f10x_tim.h"#include "misc.h"void GPIO_Conf(){ GPIO_InitTypeDef t_gpio;#include "stm32f10x_gpio.h"#include "stm32f10x_rcc.h"#include "stm32f10x_tim.h"void GPIO_Conf(){ GPIO_InitTypeDef t_gpio;
ARM(Cortex-M4啟動過程) http://shoufuban.net/content/24/0824/10/64556539_1132168343.shtml 2024/8/24 10:13:55
Reset Handler DCD NMI_Handler ;.boot_header = { .art_flag = FLASH_VALID_FLAG, .target_address = (uint8_t *)BOOT_RAM_CODEBASE, .ram_header_length = sizeof(boot_info_t)-sizeof(boot_header_t), .length = 0xffff, .bootram_crc = TO_BE_FILLED, .entry_point = boot_ram_entry, .crp_value = crp_flag, }, 分配buffer,大小為image_size – sizeof(boot_info_t). 從OFFSET為0x28處開始讀取整個image內(nèi)容到buffer中。
51與STM32單片機(jī)架構(gòu)(內(nèi)核和片上外設(shè))的區(qū)別匯總+拓展 http://shoufuban.net/content/24/0820/19/64556539_1131868615.shtml 2024/8/20 19:45:11
51與STM32單片機(jī)架構(gòu)(內(nèi)核和片上外設(shè))的區(qū)別匯總+拓展。所以,指令通過控制cpu的輸出和輸入位置,可以讓cpu寄存器向I/O端口寄存器發(fā)送數(shù)據(jù),外圍設(shè)備通過與I/O寄存器交換數(shù)據(jù),從而達(dá)到控制外圍設(shè)備的效果。cpu只能執(zhí)行所支持的指令集里的指令,不同公司的產(chǎn)品對應(yīng)有自己的指令集,cpu是出廠前預(yù)先設(shè)計制造好的電路,操作系統(tǒng)/軟件程序編寫肯定是要對照著相應(yīng)產(chǎn)品cpu的指令集,這樣的程序編譯后才能讓cpu執(zhí)行,也就是控制cpu;
RC低通濾波器原理 http://shoufuban.net/content/24/0611/16/64556539_1125922505.shtml 2024/6/11 16:51:03
RC低通濾波器原理。RC低通濾波器(RC Low-pass Filter)是一種常見的電子濾波器,用于在電路中濾除高頻信號,只允許通過低頻信號。RC低通濾波器的工作原理基于電容對信號的頻率響應(yīng)特性。因此,RC低通濾波器可以將高頻信號通過電容濾除,只保留低頻信號。在RC低通濾波器中,電阻(R)和電容(C)的組合形成了一個低通濾波器回路。總結(jié)而言,RC低通濾波器是一種常見且重要的電子濾波器,通過利用電容的頻率響應(yīng)特性來濾除高頻信號。
偏移二進(jìn)制 http://shoufuban.net/content/24/0527/19/64556539_1124479937.shtml 2024/5/27 19:09:24
偏移二進(jìn)制。然而,不同尋常的是,它不使用“excess 2 n -1 ”,而是使用“excess 2 n -1 - 1”(即excess-15、excess-127、excess-1023、excess-16383),這意味著反轉(zhuǎn)前導(dǎo)(高-order) 位的指數(shù)不會將指數(shù)轉(zhuǎn)換為正確的二進(jìn)制補碼表示法。(注意:提及 Excess-32、Excess-64、Excess-128、Excess-256、Excess-976、Excess-1023、Excess-1024、Excess-2048、Excess-16384。) 薩瓦德,約翰·JG (2018) [2005]。
電能計量芯片Sigma http://shoufuban.net/content/24/0217/15/64556539_1114299745.shtml 2024/2/17 15:29:41
掃描二維碼隨時隨地手機(jī)看文章 [導(dǎo)讀]3 補償濾波器的設(shè)計從圖3 可以看出,CIC 濾波器幅頻特性曲線在通帶內(nèi)并不平坦,在通帶內(nèi)信號被衰減.為了克服這一缺點,可加入補償濾波器,它的幅頻特性正好與CIC 濾波器相反。補償濾波器一般可借助MATLAB 仿真,再與CIC濾波器級聯(lián)觀察補償后總的頻率響應(yīng)是否滿足系統(tǒng)要求,從而得出補償濾波器的參數(shù).圖5 為圖3 中CIC濾波器加入補償后的幅頻特性曲線圖.
Design a DAC sinx/x Corrector http://shoufuban.net/content/24/0129/19/64556539_1112627461.shtml 2024/1/29 19:52:06
Design a DAC sinx/x Corrector.The frequency response of these coefficients is plotted in the top of Figure 3, along with the goal response (see Appendix for the code that computes the responses). The vertical red line is at f = fmax. The overall response of the DAC plus sinx/x corrector is shown in the bottom of Figure 3. The ripple of the overall response is less than +/- .015 dB.
Inverse Sinc Finite Impulse Response Filter Design http://shoufuban.net/content/24/0129/19/64556539_1112627416.shtml 2024/1/29 19:51:35
Inverse Sinc Finite Impulse Response Filter Design.For an inverse sinc, we have three particular regions of its frequency response: Pass-band response : invert the sinc response (compensate for droop seen in[ref:firdespm-sinc-response-freq] ) Stop-band response : attenuate as much as possible In-between response : don''''''''t care (gracefully transition between pass-band and stop-band)
【博客大賽】基于FPGA的CIC以及補償濾波器的設(shè)計 http://shoufuban.net/content/24/0129/19/64556539_1112627371.shtml 2024/1/29 19:51:09
CIC濾波器。當(dāng)CIC的M值(即states)很大時,他很難有一個平坦的通帶,在數(shù)字下變頻中,補償濾波器放在CIC之后,而在數(shù)字上變頻中,補償濾波器作為預(yù)處理放在CIC之前,總之,CIC補償濾波器是應(yīng)用在多采樣率的系統(tǒng)中,是在犧牲采樣率的基礎(chǔ)上,獲得高效的硬件性能。所以,CIC補償濾波器也可以成為“inverse sinc filter”,在多采樣率的系統(tǒng)中,CIC補償濾波器作為多采樣率濾波器,可以是插值或者抽取濾波器,但采樣率變化最少是2。
Why DAC and ADC responses droop http://shoufuban.net/content/24/0127/17/64556539_1112426531.shtml 2024/1/27 17:02:03
Why DAC and ADC responses droop.As you increase the input frequency, progressively more and more energy in the output signal resides in those higher frequency image components instead – the muck that we usually try to filter out to get a nice clean output signal. Hence the droop.
為什么DAC和ADC響應(yīng)會發(fā)生滾降? http://shoufuban.net/content/24/0127/16/64556539_1112425460.shtml 2024/1/27 16:48:48
計算sinc函數(shù)的值——參數(shù)x的值是π乘以信號頻率(f)與采樣頻率(fs)之比,即sinc(πf/fs)——可知在大約fs的0.444倍處,滾降已經(jīng)達(dá)到-3dB。圖3:以每秒1個樣本的速率采樣并保持的0.444Hz正弦波的頻譜圖,表明原始信號中的某些能量如何分布在多個圖像上。相反,隨著輸入頻率的增加,輸出信號中的能量會越來越多地逐漸駐留在這些較高頻圖像分量上——這些分量是我們通常試圖濾除的污物,以便獲得良好的干凈輸出信號。
Using the AXI DMA in Vivado http://shoufuban.net/content/23/1031/10/64556539_1102257233.shtml 2023/10/31 10:17:33
Using the AXI DMA in Vivado.Now all the memory-mapped AXI buses are connected to the DMA. Now we only have to connect the AXI streaming buses to our loopback FIFO and connect the DMA interrupts.The hello_world folder contains the Hello World software application, which we will modify to test our AXI DMA.Modify the Software Application。
FPGA http://shoufuban.net/content/23/0731/16/64556539_1090713510.shtml 2023/7/31 16:25:08
模式0:spi_sync復(fù)位時為0,接收計數(shù)器加一條件為上升沿(pedge),發(fā)送計數(shù)器加一條件為下降沿(nedge)模式1:spi_sync復(fù)位時為0,接收計數(shù)器加一條件為下降沿(nedge),發(fā)送計數(shù)器加一條件為上升沿(pedge)模式2:spi_sync復(fù)位時為1,接收計數(shù)器加一條件為下降沿(nedge),發(fā)送計數(shù)器加一條件為上升沿(pedge)模式3:spi_sync復(fù)位時為0,接收計數(shù)器加一條件為上升沿(pedge),發(fā)送計數(shù)器加一條件為下降沿(nedge)
【接口時序】4、SPI總線的原理與Verilog實現(xiàn) http://shoufuban.net/content/23/0731/15/64556539_1090710007.shtml 2023/7/31 15:58:31
I_spi_miso、O_spi_cs、O_spi_sck和O_spi_mosi是標(biāo)準(zhǔn)SPI總線協(xié)議規(guī)定的四根線;O_spi_sck (O_spi_sck ), .但是如果需要配置的寄存器有好幾百甚至上千個或者需要用SPI總線往一些顯示設(shè)備(比如OLED屏,液晶顯示屏)里面發(fā)送數(shù)據(jù)的話,如果去寫一個上千個狀態(tài)的狀態(tài)機(jī)顯然不是最好的選擇,所以對于這種需要用SPI傳輸大量數(shù)據(jù)的情況,我比較推薦的方式是先把數(shù)據(jù)存放在ROM里面,然后通過上面的SPI代碼發(fā)出去。
異步FIFO原理及Verilog實現(xiàn) – xiaoairen http://shoufuban.net/content/23/0726/14/64556539_1090094137.shtml 2023/7/26 14:13:46
FIFO可根據(jù)讀寫時鐘是否為同一時鐘域分為同步FIFO與異步FIFO,本文主要介紹異步FIFO原理、應(yīng)用及其實現(xiàn)。假設(shè)寫時鐘域?qū)懙刂犯窭状a從000->001,將寫地址同步到讀時鐘域時出錯,出錯的結(jié)果只可能為000->000,因為相鄰位的格雷碼每次只有一位發(fā)生變化,這個出錯結(jié)果實際上就是同步后的寫地址格雷碼與上一個讀時鐘采集的寫地址相比沒有發(fā)生改變,是對地址正負(fù)1誤差的判斷,頂多會使FIFO判斷為“虛空”,不影響FIFO的正確工作。
異步fifo的Verilog實現(xiàn) http://shoufuban.net/content/23/0726/14/64556539_1090093505.shtml 2023/7/26 14:09:51
跨時鐘域的問題:由于讀指針是屬于讀時鐘域的,寫指針是屬于寫時鐘域的,而異步FIFO的讀寫時鐘域不同,是異步的,要是將讀時鐘域的讀指針與寫時鐘域的寫指針不做任何處理直接比較肯定是錯誤的,因此我們需要進(jìn)行同步處理以后仔進(jìn)行比較  解決方法:加兩級寄存器同步 + 格雷碼(目的都是消除亞穩(wěn)態(tài))1.使用異步信號進(jìn)行使用的時候,好的設(shè)計都會對異步信號進(jìn)行同步處理,同步一般采用多級D觸發(fā)器級聯(lián)處理,如下圖。
Verilog實現(xiàn)之異步fifo http://shoufuban.net/content/23/0726/13/64556539_1090092052.shtml 2023/7/26 13:56:43
5 end 6 else if((rd_ptr_gray_d2[$clog2(DATA_DEPTH)-1:0]==wr_ptr_gray[$clog2(DATA_DEPTH)-1:0]) 7 &&(rd_ptr_gray_d2[$clog2(DATA_DEPTH)]!DATA_DEPTH(DATA_DEPTH)108 )asyn_fifo_inst (109 .sclk_wr (wr_clk),110 .wr_rst (wr_rst),111 .wr_en (wr_en),112 .wr_data (wr_data),113 .full (full),114 .sclk_rd (rd_clk),115 .rd_en (rd_en),116 .rd_rst (rd_rst),117 .rd_data (rd_data),118 .empty (empty)119 );
【FPGA】Vivado軟件 PLL IP核使用教程 http://shoufuban.net/content/23/0719/09/64556539_1089196105.shtml 2023/7/19 9:59:17
`timescale 1ns/1psmodule pll_test( input clk ,//20m系統(tǒng)時鐘 input rst_n , output clk_out//pll clk output);//參數(shù)定義wire locked;//ip核例化 clk_wiz_0 instance_name ( // Clock out ports .clk_out1 (clk_out ), // output clk_out1 // Status and control signals .reset (~rst_n ), // input reset .locked (locked ), // output locked // Clock in ports .clk_in1 (clk ) ); endmodule.
9、ZYNQ 啟動模式 http://shoufuban.net/content/23/0714/18/64556539_1088560169.shtml 2023/7/14 18:37:26
9、ZYNQ 啟動模式。因此要制作一個鏡像文件需要三個文件:FSBL.elf、 該工程.bit、 該工程.elf。在新窗口中,一共出現(xiàn)三個文件, 分別是 FSBL.elf、該工程 .bit、該工程 .elf 文件,如下圖所示,制作鏡像文件需要這三個文件:一般會自動添加這 3 個文件, 順序必須是 fsbl.elf、 system_wrapper.bit、 hello_world.elf, 之后直接單擊 Create Image即可完成 Boot.bin 的創(chuàng)建,此文件可作為 SD 卡啟動文件和 SPI 啟動文件。
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